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李先生 2天前在线已认证

经理 · 淮安泽群企业管理服务有限公司

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职位介绍: • 负责FPGA关键模块或链路从RTL设计、仿真、验证、综合时序、上板、联调到交付的完整闭环； • 在高速接口、数据通路、时序收敛、可靠性或上板调试等至少一个方向形成专业深度； • 参与PCIe、DDR、NAND等接口问题的逻辑、时序和系统定位； • 与硬件工程师共同分析接口交界问题，理解信号质量和时序证据，但不替代硬件承担SI/PI主责； • 与SSD FW、嵌入式软件、控制器IC和测试团队协同解决系统问题； • 在项目中按授权承担技术经理职责，负责技术方案、问题裁决和交付闭环； • 参与重大客户问题的技术定位、验证和改进； • 沉淀设计、验证、调试、问题闭环SOP和知识库。岗位要求 • 具备复杂FPGA项目的完整交付经验； • 熟悉RTL、仿真、验证、时序、上板和联调闭环； • 至少在一个关键方向具备可验证的项目深度； • 能提供本人负责模块、关键判断、问题结果和个人贡献证据； • 能与硬件、SSD FW、嵌入式软件、控制器IC和测试团队合作； • 具备项目技术决策潜力和技术问题闭环能力。优先项 • 有PCIe、DDR、NAND、NVMe、RAID、高吞吐数据通路或可靠性项目经验； • 有时序收敛、上板调试、量产问题或客户问题定位经验； • 有项目技术经理、专业带教、技术评审或关键问题Backup经验； • 有脚本、自动化验证、波形分析或AI辅助工程实践。

其他信息: 语言要求：不限; 行业要求：电子/半导体/集成电路

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