FPGA 低延迟交易系统开发工程师（高薪！） 50-80k·24薪
深圳 经验不限 统招本科 招10人 8月14日更新
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职位介绍
岗位职责：使用 Verilog/VHDL/SystemVerilog 设计开发基于 FPGA 的超低延迟交易系统，覆盖行情接收、策略逻辑与订单执行全链路；实现网络协议处理、PCIe 通信及 DDR 存储控制等关键硬件模块；实现 ITCH、OUCH、FIX、Binary 等交易所协议的硬件解析与组包，提升行情处理吞吐量；与 C++ 开发团队协作完成 FPGA 与主机端协同优化，降低系统整体延迟；负责 FPGA 逻辑的时序收敛、资源优化及功耗控制，使用 ILA/ChipScope 等工具进行板级调试。 任职要求：本科及以上学历，计算机、电子工程、通信、微电子等相关专业；3 年以上 FPGA 开发经验，有完整的芯片选型、RTL 编码、仿真、综合、布局布线及板级验证全流程经验；精通 Verilog 或 VHDL，熟悉 SystemVerilog/UVM 验证方法学；熟练掌握 Xilinx（Vivado）或 Intel/Altera（Quartus）开发工具链，熟悉 Kintex-7、Virtex UltraScale+ 或 Stratix 系列者优先；深入理解并实战过 PCIe（DMA）、Ethernet（10G/25G/100G）、DDR3/DDR4 等高速接口开发；有低延时网卡开发、HLS 经验或金融交易系统加速、行情加速经验者优先。
其他信息
语言要求：不限
行业要求：基金/证券/期货

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更新时间：2026-08-16